高性能小數(shù)分頻鎖相環(huán)的研究與實現(xiàn)
關鍵詞：鎖相環(huán) 小數(shù)分頻 小數(shù)雜散 dac噪聲補償
摘要：隨著集成電路技術的迅猛發(fā)展,芯片內(nèi)時鐘信號精度要求越來越高,如何提高時鐘信號的品質(zhì)是集成電路行業(yè)的研究重點。小數(shù)分頻鎖相環(huán)是時鐘信號實現(xiàn)高分辨率、快速變頻的常用結構,但是受到自身結構的制約,小數(shù)分頻鎖相環(huán)會引入大量雜散噪聲,雜散噪聲對輸出信號影響極大,在設計中消除和抑制雜散噪聲成為挑戰(zhàn)。論文通過分析小數(shù)分頻鎖相環(huán)的基本結構,研究了雜散與噪聲種類和來源,解釋了雜散與噪聲的產(chǎn)生機理,提出了一種基于DAC的噪聲補償技術,設計并實現(xiàn)了一款高性能、低相噪的小數(shù)分頻鎖相環(huán)。鎖相環(huán)分頻精度為24位,功耗為3.4mW,面積為0.06mm^2。
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